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標題: 硬件語言描述verilog試題 [打印本頁]

作者: 神說要有光 時間: 2017-12-23 20:26
標題: 硬件語言描述verilog試題
試題如下
硬件描述語言實驗 C類題目
1、利用實驗時開發板資源，設計一個模 10 以內的加法計數器并與按鍵輸入值進行比較，
比較結果在發光管上顯示，包含計數器模塊、比較器模塊。

桂林電子科技大學試題(樣卷)
課程名稱：硬件描述語言（C類）適用班級：本科

學號:                姓名:                   機號:

一、考試要求：
1．  本次考試為開卷上機考試，考試時間為90分鐘。
2．  考生應嚴格按照各項題意要求作題，如在題意要求的路徑下沒有考生文件，將視為白卷。
3．  畫圖過程中請注意及時存檔，以免文件意外丟失！由于誤操作引起的死機由考生自己負責。
二、考試內容：
1．在 F:\盤下新建一文件夾“××××××××××” ，其中“××××××××××”為考生學號，所有程序
均在該目錄下完成，在其他路徑或文件夾下完成的視為白卷。
2.題目要求如下:
①新建一個以“kaoshi”命名的工程文件。
②  設計一個計數器模塊，模值為8的計數器，輸入信號：clk,輸出為q [3..0]。
③  設計比較器模塊。
④  建立頂成原理圖，調用②③模塊，進行相應連接，并定義輸入、輸出引腳，比較器一個輸入端為計數
器輸出、另一輸入端為擴展板上A組數據，比較結果用擴展板上右邊三個發光管表示（IO74\75\76）。
⑤  放置相關端口關閉蜂鳴器。
⑥  下載到開發板驗證結果。

全部資料51hei下載地址：

C.pdf (62.11 KB, 下載次數: 8)