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標題: 發一個任意數分頻的程序 [打印本頁]
作者: Mystery0724    時間: 2019-3-28 09:35
標題: 發一個任意數分頻的程序
本帖最后由 Mystery0724 于 2019-3-28 09:39 編輯

  1. module divide(
  2.                                         clk,
  3.                                         rst_n,
  4.                                         clkout);

  6. input         clk,rst_n;
  7. output        clkout;   

  9. parameter        WIDTH        = 3;         
  10. parameter        N = 5;            

  12. reg         [WIDTH-1:0]        cnt_p,cnt_n;   //cnt_p為上升沿觸發時的計數器，cnt_n為下降沿觸發時的計數器
  13. reg        clk_p,clk_n;     //clk_p為上升沿觸發時分頻時鐘，clk_n為下降沿觸發時分頻時鐘

  15. //上升沿觸發時計數器的控制
  16. always @ (posedge clk or negedge rst_n )         
  17. begin
  18.         if(!rst_n)
  19.                 cnt_p<=0;
  20.         else if (cnt_p==(N-1))
  21.                 cnt_p<=0;
  22.         else cnt_p<=cnt_p+1;            
  23. end
  24.                
  25. always @ (posedge clk or negedge rst_n)
  26. begin
  27.         if(!rst_n)
  28.                 clk_p<=0;
  29.         else if (cnt_p<(N>>1))          //N>>1表示右移一位，相當于除以2去掉余數
  30.                 clk_p<=0;
  31.         else
  32.                 clk_p<=1;               //得到的分頻時鐘正周期比負周期多一個clk時鐘
  33. end

  35.           //下降沿觸發時計數器的控制               
  36. always @ (negedge clk or negedge rst_n)
  37.         begin
  38.                 if(!rst_n)
  39.                         cnt_n<=0;
  40.                 else if (cnt_n==(N-1))
  41.                         cnt_n<=0;
  42.                 else cnt_n<=cnt_n+1;
  43.         end

  45.           //下降沿觸發的分頻時鐘輸出，和clk_p相差半個時鐘
  46. always @ (negedge clk)
  47.         begin
  48.                 if(!rst_n)
  49.                         clk_n<=0;
  50.                 else if (cnt_n<(N>>1))  
  51.                         clk_n<=0;
  52.                 else
  53.                         clk_n<=1;                //得到的分頻時鐘正周期比負周期多一個clk時鐘
  54.         end

  56.           assign clkout = (N==1)?clk:(N[0])?(clk_p&clk_n):clk_p;      //條件判斷表達式
  57.                                                                                                                                                                           //當N=1時，直接輸出clk
  58.                                                                                                                                                                           //當N為偶數也就是N的最低位為0，N（0）=0，輸出clk_p
  59.                                                                                                                                                                           //當N為奇數也就是N最低位為1，N（0）=1，輸出clk_p&clk_n。正周期多所以是相與
  60. endmodule
復制代碼


作者: shuijingfeng    時間: 2019-7-25 15:06
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