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標(biāo)題: Verlog已經(jīng)在CPLD_EPM240調(diào)試OK [打印本頁(yè)]

作者: 清夢(mèng)一場(chǎng) 時(shí)間: 2019-5-16 10:26
標(biāo)題: Verlog已經(jīng)在CPLD_EPM240調(diào)試OK
有了這些基礎(chǔ)的代碼可以更加快速的入門(mén)FPGA

1位數(shù)碼管動(dòng)態(tài)顯示.7z

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3-8 譯碼器.7z

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8位優(yōu)先編碼器.7z

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LED燈旋轉(zhuǎn).7z

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LED花樣流水燈.7z

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LED花樣跑馬燈.7z

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按鍵與數(shù)碼管顯示.7z

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撥碼開(kāi)關(guān)_LED.7z

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乘法器.7z

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除法器.7z

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串口與電腦通信.7z

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二進(jìn)制轉(zhuǎn)BCD碼.7z

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分頻1秒.7z

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分頻1秒和0.5秒.7z

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蜂鳴器.7z

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加法器.7z

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減法器.7z

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簡(jiǎn)單狀態(tài)機(jī).7z

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矩陣鍵盤(pán).7z

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秒表數(shù)碼管顯示.7z

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時(shí)鐘_clock.7z

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數(shù)碼管靜態(tài)顯示0到7.7z

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四位比較器.7z

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