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標(biāo)題: DC-DC芯片F(xiàn)B腳和二極管之間需要延長(zhǎng)導(dǎo)線或者串小電感為什么？ [打印本頁]

作者: HU1123 時(shí)間: 2023-11-28 09:44
標(biāo)題: DC-DC芯片F(xiàn)B腳和二極管之間需要延長(zhǎng)導(dǎo)線或者串小電感為什么？
DC-DC芯片F(xiàn)B腳和二極管之間需要延長(zhǎng)一小段導(dǎo)線或者串小電感才能夠保證輸出電壓穩(wěn)定，如果沒有延長(zhǎng)或添加小電感輸出電壓會(huì)不穩(wěn)定且電壓平均輸出會(huì)高于設(shè)定電壓2v，這是有什么東西影響嗎?有沒有遇見的大佬幫忙解釋一下。

51hei截圖_20231128133950.png (502.54 KB, 下載次數(shù): 96)

作者: chxelc 時(shí)間: 2023-11-28 11:53
具體是用的什么DC-DC方案？

作者: 君工創(chuàng) 時(shí)間: 2023-11-28 12:41
原理圖在哪?

作者: HU1123 時(shí)間: 2023-11-28 13:21
sy7208推薦電路

作者: HU1123 時(shí)間: 2023-11-28 13:25
不過在fb腳的電阻是數(shù)字電阻用于調(diào)壓

作者: HU1123 時(shí)間: 2023-11-28 13:29
用的是矽力杰的sy7208推薦電路，電感和二極管直接通過鋪銅過孔直接兩面焊接的

作者: HU1123 時(shí)間: 2023-11-28 13:41

君工創(chuàng) 發(fā)表于 2023-11-28 12:41
原理圖在哪?

原理圖沒有問題，之前用過，新的設(shè)計(jì)重新改版出現(xiàn)的問題

作者: EdwardTsapiev 時(shí)間: 2023-11-28 16:30
從數(shù)據(jù)表中推薦的拓?fù)鋪砜矗撔酒瑢?duì) FB 輸入處的干擾很敏感（電阻 R1 和 R2 盡可能靠近 FB 引腳）。

或者，電壓的“高估”可以是反饋電路的自激頻率與“正常開關(guān)”頻率（1 MHz）的疊加，即反饋?zhàn)優(yōu)檎皇秦?fù)。反過來，添加電感器可以減少 FB 輸入處的干擾（噪聲）（恢復(fù)負(fù)反饋）并允許芯片“正常”運(yùn)行。

選項(xiàng)二，反饋的操作很可能受到U5芯片的引腳6的內(nèi)部電容的影響。也許將 U5 芯片的引腳 5“接地”并將電阻器 R20 移動(dòng)到引腳 6 將“穩(wěn)定”操作，而無需在 FB 輸入處添加額外的扼流圈。

附言。 ...這種“簡(jiǎn)單電路”的“小修改”通常會(huì)導(dǎo)致“手鼓薩滿舞蹈”和電路板拓?fù)涞闹貜?fù)修改（根據(jù)我的經(jīng)驗(yàn):(

作者: HU1123 時(shí)間: 2023-11-28 18:00

EdwardTsapiev 發(fā)表于 2023-11-28 16:30
從數(shù)據(jù)表中推薦的拓?fù)鋪砜矗撔酒瑢?duì) FB 輸入處的干擾很敏感（電阻 R1 和 R2 盡可能靠近 FB 引腳）。

或 ...

實(shí)際電路中r5接在c2后面（我的失誤

），電路中數(shù)字電位器改動(dòng)成旋鈕的電位器沒有改善（應(yīng)該不會(huì)存在電容影響了），在r20處并過一個(gè)10pf電容可以改善輸出電壓不穩(wěn)但是不能承受較大負(fù)載，在負(fù)載40mA時(shí)電壓明顯被拉下來了。重新串了一個(gè)磁珠在D1前后輸出電路中輸出沒有問題，但是在r5處串聯(lián)磁珠沒有任何改善，正常應(yīng)該可以影響吧，不知道什么原因。

作者: 君工創(chuàng) 時(shí)間: 2023-11-28 22:07
估計(jì)在排版的時(shí)候，R5取樣點(diǎn)在濾波電容之前。

作者: HU1123 時(shí)間: 2023-11-29 08:44

君工創(chuàng) 發(fā)表于 2023-11-28 22:07
估計(jì)在排版的時(shí)候，R5取樣點(diǎn)在濾波電容之前。

實(shí)際排版是先接的220,10,10,0.1的電容后才連的反饋線。

作者: 君工創(chuàng) 時(shí)間: 2023-11-29 12:08

HU1123 發(fā)表于 2023-11-29 08:44
實(shí)際排版是先接的220,10,10,0.1的電容后才連的反饋線。

我以前有一電路沒有自激，改版之后有自激。排查發(fā)現(xiàn)因?yàn)橛幸恍《尉€路沒有了并行布線，相當(dāng)于沒有了線間電容和共模電感。

作者: HU1123 時(shí)間: 2023-11-30 10:09

君工創(chuàng) 發(fā)表于 2023-11-29 12:08
我以前有一電路沒有自激，改版之后有自激。排查發(fā)現(xiàn)因?yàn)橛幸恍《尉€路沒有了并行布線，相當(dāng)于沒有了線間電 ...

這種現(xiàn)象不太適用于我的這種方案上，原來的電路中也沒有產(chǎn)生共模電感和線間電容的位置，我的現(xiàn)象就像是對(duì)于信號(hào)的抑制沒有到位一樣，輸出的電平要絕對(duì)平滑才能使反饋?zhàn)龀稣_調(diào)節(jié)。這個(gè)就很怪

作者: amwhibo 時(shí)間: 2023-11-30 11:16
這家公司的芯片比較難用，對(duì)于電子方面不是很強(qiáng)的人，要求比較高。使用過兩款芯片，都沒有設(shè)計(jì)出來。隨便修改一下，就達(dá)不到理想的效果。

作者: wufa1986 時(shí)間: 2023-11-30 13:29
理論上是越短越好，加長(zhǎng)只是表面好了，但是可能有隱患，最好做一下高低溫測(cè)試

作者: HU1123 時(shí)間: 2023-11-30 15:48

amwhibo 發(fā)表于 2023-11-30 11:16
這家公司的芯片比較難用，對(duì)于電子方面不是很強(qiáng)的人，要求比較高。使用過兩款芯片，都沒有設(shè)計(jì)出來。隨便修 ...

主要找不到他家的技術(shù)支持，電話，郵件都聯(lián)系不到，芯片是公司采購(gòu)的，還得老大拍板好難

作者: HU1123 時(shí)間: 2023-11-30 15:53

wufa1986 發(fā)表于 2023-11-30 13:29
理論上是越短越好，加長(zhǎng)只是表面好了，但是可能有隱患，最好做一下高低溫測(cè)試

確實(shí)，主要是很多點(diǎn)位不讓測(cè)試，一碰就開始波動(dòng)，現(xiàn)在改版只能靠近理論設(shè)計(jì)，在電路中留下串磁珠的位置，不行就直接強(qiáng)行抑制電平波動(dòng)，估計(jì)高低溫應(yīng)該可以過，剩下的聽天由命。

作者: 597329015 時(shí)間: 2023-12-1 11:09
電感是一種存儲(chǔ)電能的被動(dòng)元件，它可以在電流變化時(shí)產(chǎn)生電壓，或者在電壓變化時(shí)產(chǎn)生電流。當(dāng)芯片輸出電流變化大時(shí)，電感能夠通過產(chǎn)生反電動(dòng)勢(shì)（EMF）來穩(wěn)定輸出電壓。此外，電感還能夠?qū)Ω哳l信號(hào)進(jìn)行濾波，進(jìn)一步減小輸出電壓波動(dòng)。如果沒有延長(zhǎng)導(dǎo)線或添加小電感，可能會(huì)導(dǎo)致輸出電壓波動(dòng)較大。這是因?yàn)椋?dāng)芯片輸出電流變化大時(shí)，由于電感效應(yīng)不足，電容和二極管等元件無法快速響應(yīng)，從而導(dǎo)致輸出電壓波動(dòng)較大。此外，如果電容和二極管等元件的質(zhì)量較差，也可能會(huì)對(duì)輸出電壓穩(wěn)定性造成影響。在實(shí)際設(shè)計(jì)中，為了提高DC-DC轉(zhuǎn)換器的輸出電壓穩(wěn)定性，通常會(huì)在芯片F(xiàn)B腳和二極管之間添加一個(gè)小電感或延長(zhǎng)一小段導(dǎo)線。這樣可以增加輸出電壓的穩(wěn)定性，同時(shí)也可以減小輸出電壓的紋波值。需要注意的是，選擇合適的電感參數(shù)非常重要，過小或過大的電感都可能會(huì)對(duì)系統(tǒng)穩(wěn)定性產(chǎn)生負(fù)面影響。

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