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標(biāo)題: PCB 設(shè)計注意事項系列 5：時鐘和網(wǎng)口 [打印本頁]
作者: Gropher    時間: 2017-5-3 17:49
標(biāo)題: PCB 設(shè)計注意事項系列 5：時鐘和網(wǎng)口
CLK 分類：

1） HostClock：MCH_BCLK（差分信號）和 CPU_BCLK（差分信號），166/200MHZ

2） PCI_CLK：PCI_CLK【5:0】，33MHZ

3） REFCLK：14MHZ

4） USBCLK：48MHZ

5） DOTCLK：96MHZ

6） SRCCLK：（serial referenceclock）100MHZ

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PCB設(shè)計注意事項系列5：時鐘和網(wǎng)口.pdf (499.59 KB, 下載次數(shù): 8)





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