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發(fā)布時(shí)間: 2018-4-21 19:50
正文摘要:初學(xué)習(xí)verilog_經(jīng)驗(yàn) 先記下來： 1、不使用初始化語句； 2、不使用延時(shí)語句； 3、不使用循環(huán)次數(shù)不確定的語句，如：forever，while 等； 4、盡量采用同步方式設(shè)計(jì)電路； 5、盡量采用行為語句完成設(shè)計(jì)； ... |
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