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關于單片機IIC總線模擬起始和終止信號的問題!

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發布時間: 2018-11-30 14:03

正文摘要:

我搞不懂,模擬終止信號為什么SCL時鐘線電平為什么要拉低,按道理來說,模擬起始信號和終止信號都是時鐘線電平處于高電平狀態,然后變幻的是數據線sda,起始是由高到低,終止是由低到高過程中,不是說時鐘信號都保持 ...

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ID:401564 發表于 2018-11-30 17:28
IIC有嚴格的時序的,也就是說,你得照著人家的協議一步一步的來,那么問題來了:為什么要先拉低時鐘線呢?
如果你不管它,你就不知道剛才時鐘線是什么狀態的,如果是高電平呢?那么你SDA在時鐘線為高的時候,產生的所有變化都會被視為起始或者停止信號,明白了沒有?
邏輯關系這種東西是死的,是怎么樣就怎么樣,所以,一定要確定狀態。

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