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發(fā)布時(shí)間: 2021-2-11 11:27
正文摘要:兩根線 應(yīng)該是scl和sda,scl頻率500Hz,嘗試用i2c解碼但好像不太對,請教下大家,謝謝,新年快樂 |
| 下降沿鎖數(shù)據(jù) 上升沿在變化不能鎖 |
xhaity 發(fā)表于 2021-2-11 18:20 明顯是下降沿鎖數(shù)據(jù)。時(shí)鐘上升沿?cái)?shù)據(jù)在變化，此時(shí)不能鎖。 |
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就是一個(gè)普通的同步傳輸，上升沿把數(shù)據(jù)鎖定 |
| 趕腳是SPI，，，IIC的上下沿不能對的這么整齊。 |
| 壓縮包是邏輯分析儀采集的數(shù)據(jù),dslogic的 |
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