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allegro導入網表遇到flash問題

查看數: 1010 | 評論數: 2 | 收藏 0

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發布時間: 2024-5-30 11:08

正文摘要:

起初是在import 原理圖產生的網表到PCB的brd文件時所遇到如圖所示的問題，但是我檢查過路徑以及pad和dra和psm文件都是存在的。 DEFAULT INTERNAL是我關閉anti_pad產生的問題（貌似關 ...

回復

ID:945345 發表于 2024-5-30 15:23

目前已經解決，就是說要把那個器件create symbols→export libraries最后再導入原理圖網表就沒問題了

ID:945345 發表于 2024-5-30 15:22

目前解決了，就是說要對單個器件的封裝create symbol，然后再export libraries然后導入網表就沒問題了

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