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MSP430F413單片機(jī)不用的空余腳怎么處理功耗最低?

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ID:328638 發(fā)表于 2018-8-5 13:43 來自觸屏版 | 顯示全部樓層 |閱讀模式
MSP430F413的單片機(jī)芯片,不用的引腳怎樣處理,要求功耗最低
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ID:383138 發(fā)表于 2018-8-5 16:13 | 顯示全部樓層
無用腳輸出高低都行

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ID:383138 發(fā)表于 2018-8-5 16:14 | 顯示全部樓層
輸出,高低都行
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ID:328638 發(fā)表于 2018-8-5 17:52 來自觸屏版 | 顯示全部樓層
徐工你對430布線熟悉嗎,
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ID:383177 發(fā)表于 2018-8-5 18:29 | 顯示全部樓層
當(dāng)GPIO管腳配置為輸入管腳且外部電平處于浮動(dòng)狀態(tài)時(shí)(0<Vin<Vcc),那么內(nèi)部的MOSFETs管的導(dǎo)通電流本身就處于一個(gè)不穩(wěn)定的值,會(huì)導(dǎo)致整體功耗的升高。

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ID:383177 發(fā)表于 2018-8-5 18:30 | 顯示全部樓層
為了使MSP430最大限度的達(dá)到低功耗,對于MSP430未使用的GPIO而言,應(yīng)該將其設(shè)置為輸出;或者是設(shè)置為輸入,但是將管腳的電平固定,可以通過外部電路將管腳連接至Vcc或者GND,也可使能內(nèi)部上下拉電阻,將管腳電平固定。

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ID:383177 發(fā)表于 2018-8-5 18:39 | 顯示全部樓層

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ID:383177 發(fā)表于 2018-8-5 18:58 | 顯示全部樓層
CMOS器件引腳由N溝道和P溝道場效應(yīng)管,通常在一個(gè)時(shí)刻,只有一個(gè)管子是開通的,但是,有一個(gè)非常短的時(shí)間轉(zhuǎn)換期,這兩種管子都會(huì)部分導(dǎo)通,在一個(gè)管子關(guān)閉而另一個(gè)開啟的時(shí)候。一個(gè)沒有端接的輸入口可能振蕩或在一個(gè)中間電平上浮動(dòng),導(dǎo)致所有場效應(yīng)管設(shè)備都將在一個(gè)微導(dǎo)通的狀態(tài),導(dǎo)致了管子的損耗,增加了噪聲,并要消耗額外的電源電流。
(Input Only)輸入專用管腳
使用上拉或下拉電阻,將每個(gè)未使用的引腳拉到VSS或VDD,這是推薦的使用方法
捆綁在一起,并用單個(gè)電阻上拉/下拉到VDD或地,節(jié)省元件數(shù)量和成本,但是這減少了減少的靈活性。 1.jpg
2.jpg
(Input/Output)輸入/輸出引腳
每個(gè)引腳的下拉一個(gè)電阻到地(VSS)。
幾個(gè)引腳連下拉同一個(gè)電阻到地(VSS)。
不連接的針腳,軟件程序配置IO口為輸出口,并將它們設(shè)置為輸出低。
連接一個(gè)電阻到Vss,軟件程序配置IO口為輸出低。
直接連接到地,軟件程序把端口配置成高阻抗輸入口,設(shè)置寄存器為輸出低狀態(tài)。
     注意這將引發(fā)雙發(fā)失誤導(dǎo)致的問題(引腳從輸入到輸出的變化,輸出從低到高狀態(tài)變化)。風(fēng)險(xiǎn)在于上圖。
最后,覺得還是每個(gè)電阻接到地比較安全。

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ID:383205 發(fā)表于 2018-8-5 20:02 | 顯示全部樓層
設(shè)置為輸出模式,固定電平,但不要接上下拉電阻

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ID:328638 發(fā)表于 2018-8-6 14:35 來自觸屏版 | 顯示全部樓層
helloStm32 發(fā)表于 2018-8-5 20:02
設(shè)置為輸出模式,固定電平,但不要接上下拉電阻

老師的意思,不用引腳為空腳,采樣輸入只有一路,其余的輸入怎樣設(shè)置

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