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參考時鐘帶狀線損耗分析

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ID:81155 發表于 2015-5-26 11:04 | 只看該作者回帖獎勵

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1. 概述

由于電路板面積尺寸的限制或者時鐘布局的需要，導致時鐘電路源端和終端離得比較遠，此時在電路板中走線多數將時鐘走線走在內層，避免受到其他電路的干擾，或者干擾其他敏感電路，此文主要分析時鐘線走內層產生的插損，對系統的影響。

關鍵詞：時鐘；帶狀線；匹配；損耗

參考時鐘帶狀線損耗分析.zip

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