AD原理圖生成PCB，取消掉room空間的方法

ID:90228 · 發(fā)表于 2015-9-29 13:08

問題現(xiàn)狀描述:

從原理圖生成PCB時(shí)，總會(huì)生成一個(gè)網(wǎng)絡(luò)區(qū)域，怎么樣可以取消此區(qū)域(room空間)。

處理 Rooms 的問題方法：

選擇 project -> projectoptions, 彈出下對話框后, 選擇對話框中的 ECO Genaration 。

ID:153199 · 發(fā)表于 2017-2-13 11:45

不錯(cuò)的文件，值得收藏

ID:592475 · 發(fā)表于 2020-3-4 15:19

解決困擾，點(diǎn)了好久

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