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單片機p0口外接數碼管上拉電阻的問題

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ID:253035 發表于 2017-11-25 22:40 來自手機 | 顯示全部樓層 |閱讀模式
單片機io接了上拉電阻的話,外部5v的壓降全部加載到1k電阻上,輸出5ma電流
如果沒有上拉電阻的話,外部電壓全部加載到數碼管上電流不應該更大嗎
主要是不太理解p0口置1有無上拉電阻時,電路中的電流究竟是怎么來的,p0口輸出電壓究竟是多少(5v?)與外接5v電源在電路之間的關系,望各位大俠指點一二
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ID:253655 發表于 2017-11-26 00:44 | 顯示全部樓層
單片機是5V供電的話,IO口的電壓就是0V或5V。當IO口為0V時,數碼管電流不是5毫安,計算方法為供電電壓(5V)-IO口電壓(0V)-數碼管電壓(0.7v),再除以1K
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ID:155507 發表于 2017-11-26 08:57 | 顯示全部樓層
樓主看一下單片機的內部結構吧!
你看了片子內部結構就知道除了P0口外 其他3口都接了上拉電阻 所以 一旦P0口要用作I\O口使用 就必須接上拉電阻

對于共陰極數碼管,需要高電平才能驅動
P0為什么要上拉電阻原因有:
1。 P0口片內無上拉電阻
2。 P0為I/O口工作狀態時,上方FET被關斷,從而輸出腳浮空,因此P0用于輸出線時為開漏輸出。
3。 由于片內無上拉電阻,上方FET又被關斷,P0輸出1時無法拉升端口電平。
4、上拉電阻是用來解決總線驅動能力不足時提供電流的。一般說法是拉電流,
驅動能力與功耗的平衡。以上拉電阻為例,一般地說,上拉電阻越小,驅動能力越強,但功耗越大,設計是應注意兩者之間的均衡。

不過,加1K上拉后,電流并不是5V/1K=5mA。因為led一般會有2V左右的壓降,這樣1K電阻兩端只有3V左右的電壓,流過的電流只有3mA左右!
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ID:155507 發表于 2017-11-26 08:58 | 顯示全部樓層
傳統的51單片機P0口的電流驅動能力較弱。如果用來驅動數碼管(多段的LED),建議增加外部的驅動器:用51單片機的P0口驅動外部驅動器,再由外部驅動器驅動數碼管。這時P0口可以不用上拉電阻。
(外部驅動器可以是三極管或集成電路)
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ID:113415 發表于 2017-11-26 09:00 | 顯示全部樓層
關于上拉電阻作用的解釋:
  先看圖(本圖僅供示意,并不是內部真的構造!),芯片內部,每個IO管腳都有相應的場管,其集電極(漏極)有電阻,這個電阻能提供的電流是有限的,如果負載需要電流小于這個限度,則不加上拉電阻也能工作。
  當負載電流較大,超出限度后,必須加上拉電阻,本質上,就是在原來集電極電阻基礎上又并聯了一個集電極電阻。
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ID:242746 發表于 2017-11-26 11:55 | 顯示全部樓層
P0口沒有內部上拉電阻,相當于開漏輸出,只有接地與不接地兩種狀態。用于驅動LED等負載可以不加上拉電阻,相當于在LED負極串聯開關。但是要驅動芯片之類時,無法輸出1,必須加上拉。
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ID:253035 發表于 2017-11-26 15:39 | 顯示全部樓層
angmall 發表于 2017-11-26 08:57
樓主看一下單片機的內部結構吧!
你看了片子內部結構就知道除了P0口外 其他3口都接了上拉電阻 所以 一旦P0 ...

可不可以這樣理解,P0口置1時處于懸空狀態,電流直接由外部5V電源經過圖上交叉的節點和數碼管流向接地的P2口,P0口置0時接地,電流不會經過數碼管直接流量P0內部的地。
但是如果沒有這個上拉電阻的話,P0口置1時,沒有電阻的電流同樣是由外部電源經過中間節點流向數碼管嗎
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ID:155507 發表于 2017-11-26 18:27 | 顯示全部樓層
但是如果沒有這個上拉電阻的話,P0口置1時,處于懸空狀態,電流怎么來的?
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ID:111634 發表于 2017-11-26 19:18 | 顯示全部樓層
先學理論,打基礎,否則,問題多多,事倍功半。
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ID:253035 發表于 2017-11-26 19:54 | 顯示全部樓層
angmall 發表于 2017-11-26 18:27
但是如果沒有這個上拉電阻的話,P0口置1時,處于懸空狀態,電流怎么來的?

圖中不是接了排阻上方外部5v電源嗎,與接地P2口難道 不能行成壓差嗎,P0口懸空的時候
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ID:253035 發表于 2017-11-26 19:56 | 顯示全部樓層
zl2168 發表于 2017-11-26 19:18
先學理論,打基礎,否則,問題多多,事倍功半。

感覺到了,現在就是想回頭來把不太理解的都搞明白,之前都是編個程序就完事了,電路為什么這么設計不太了解
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ID:253988 發表于 2017-11-26 23:49 | 顯示全部樓層
P0為什么要上拉電阻原因有:
1。 P0口片內無上拉電阻
2。 P0為I/O口工作狀態時,上方FET被關斷,從而輸出腳浮空,因此P0用于輸出線時為開漏輸出。
3。 由于片內無上拉電阻,上方FET又被關斷,P0輸出1時無法拉升端口電平。
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